multiprocessor scheduling中文是什么意思

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中文翻譯
造句

多處理機(jī)調(diào)度

schedule n. 1.目錄。 2.表(格)；清單，明細(xì)表。 3.〔美 ...
multiprocessor 多處理機(jī), 多處理器; 多處理機(jī)；多處理器; 多重處理程序計(jì)算機(jī); 多重處理機(jī); 多重信息處理機(jī)
scheduling 編排；調(diào)度; 編排進(jìn)度; 編制程序；編目錄; 編制計(jì)劃; 編制進(jìn)度計(jì)劃; 程序安排; 調(diào)度進(jìn)度安排進(jìn)度計(jì)劃安排編制目錄編制圖表制時(shí)間表; 廣告排期表; 計(jì)算機(jī)輔助液體管道調(diào)度; 排班; 排程; 日程安排; 行程安排; 造表; 制時(shí)間表
asymmetric multiprocessor 非對(duì)稱型多處理機(jī)
autonomous multiprocessor 獨(dú)立多處理機(jī)
commercial multiprocessor 商業(yè)多用處理機(jī)
conventional multiprocessor 常規(guī)多處理機(jī)
distributed multiprocessor 分布式多處理機(jī); 分散式多處理機(jī)
exploratory multiprocessor 勘探多用處理機(jī)
heterochromous multiprocessor 異構(gòu)型多處理機(jī); 異質(zhì)功能多處理機(jī)
heterogeneous multiprocessor 異構(gòu)型多處理機(jī); 異質(zhì)功能多處理機(jī)
homogeneous multiprocessor 同構(gòu)型多處理機(jī)
modularized multiprocessor 模塊化多處理機(jī)
multibus multiprocessor 多總線多處理機(jī)
multiprocessor analysis 多處理機(jī)分析
multiprocessor architecture 多處理機(jī)體系結(jié)構(gòu); 多處理機(jī)系統(tǒng)結(jié)構(gòu)
multiprocessor array 多處理機(jī)陣列
multiprocessor computer 多處理機(jī)計(jì)算機(jī)
multiprocessor configuration 多處理機(jī)配置
multiprocessor cycle 多處理機(jī)周期
multiprocessor interleaving 多處理機(jī)交叉存取; 多處理機(jī)交錯(cuò)
multiprocessor link 多處理機(jī)鏈路
multiprocessor mode 多處理機(jī)方式
multiprocessor organization 多處理機(jī)組織
multiprocessor performance 多處理機(jī)性能

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例句與用法

The first part of this paper is theoretical algorithms including building radar targets model based on scattering center and fast matching classification for one dimensional high - resolution range profile ( hrrp ) ; the second part is system realization including performance analysis and algorithm mapping of cluster - bus multiprocessor system , design of multiprocessor scheduling algorithm , realization of missile - carrying multiprocessor system
本文結(jié)合國(guó)防科技重點(diǎn)預(yù)研項(xiàng)目“毫米波主動(dòng)尋的制導(dǎo)目標(biāo)識(shí)別” ，主要開(kāi)展彈載寬帶毫米波雷達(dá)目標(biāo)識(shí)別技術(shù)和實(shí)時(shí)信號(hào)處理技術(shù)及其實(shí)現(xiàn)的研究工作。緒論部分對(duì)寬帶毫米波雷達(dá)精確制導(dǎo)與自動(dòng)目標(biāo)識(shí)別技術(shù)及實(shí)時(shí)信號(hào)處理技術(shù)進(jìn)行了簡(jiǎn)要評(píng)述。
Based on the comparison of existing performance evaluation methods and analysis of the characteristic of scheduling problem in hardware / software codesign , the thesis presents a m system performance evaluation method based on " dynamic critical path first " heterogeneous multiprocessor schedule algorithm . experiments show the schedule algorithm is better than some other scheduling algorithms
在對(duì)現(xiàn)有性能評(píng)價(jià)方法的深入對(duì)比研究和對(duì)軟硬件協(xié)同設(shè)計(jì)中調(diào)度問(wèn)題分析的基礎(chǔ)上，本文提出了基于動(dòng)態(tài)關(guān)鍵路徑優(yōu)先調(diào)度進(jìn)行系統(tǒng)層性能評(píng)價(jià)的方法，實(shí)驗(yàn)表明該方法優(yōu)于其它幾種調(diào)度算法。

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